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IDT7005S/L
High-Speed 8K x 8 Dual-Port Static RAM
Pin Configurations (1,2,3) (con't.)
Military, Industrial and Commercial Temperature Ranges
11/19/01
51 50
48
46 44 42 40 38
36
11
A 5L
A 4L
A 2L
A 0L BUSY L M/ S
INT R
A 1R
A 3R
53
52
49
47
45 43 41
39 37
35
34
10
A 7L
A 6L
A 3L
A 1L
INT L GND BUSY R
A 0R
A 2R
A 4R
A 5R
55
54
32
33
09
08
A 9L
57
A 11L
59
A 8L
56
A 10L
58
A 7R
30
A 9R
28
A 6R
31
A 8R
29
07
V CC
A 12L
IDT7005G
A 11R
A 10R
G68-1(4)
61
60
26
27
06
N/C
N/C
68-Pin PGA
Top View(5)
GND
A 12R
63
05 SEM L
65
62
CE L
64
24
N/C
22
25
N/C
23
04
03
OE L
67
I/O 0L
R/ W L
66
N/C
SEM R
20
OE R
CE R
21
R/ W R
68
1 3 5 7 9
11 13 15
18 19
02
I/O 1L
I/O 2L I/O 4L
GND
I/O 7L GND
I/O 1R
V CC I/O 4R I/O 7R
N/C
,
2 4
6 8
10 12 14 16
17
01
I/O 3L I/O 5L
I/O 6L
V CC
I/O 0R
I/O 2R I/O 3R I/O 5R I/O 6R
A
B
C
D
E
F
G
H
J
K
L
INDEX
2738 drw 04
NOTES:
1. All V CC pins must be connected to power supply.
2. All GND pins must be connected to ground supply.
3. Package body is approximately 1.18in x 1.18in x .16in.
4. This package code is used to reference the package diagram.
5. This text does not indicate oriention of the actual part-marking
Pin Names
Left Port
Right Port
Names
CE L
R/ W L
OE L
A 0L - A 12L
I/O 0L - I/O 7L
SEM L
INT L
BUSY L
CE R
R/ W R
OE R
A 0R - A 12R
I/O 0R - I/O 7R
SEM R
INT R
BUSY R
M/ S
V CC
GND
Chip Enable
Read/Write Enable
Output Enable
Address
Data Input/Output
Semaphore Enable
Interrupt Flag
Busy Flag
Master or Slave Select
Power
Ground
2738 tbl 01
3
6.42
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